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一種用VHDL設(shè)計(jì)實(shí)現(xiàn)的有線電視機(jī)頂盒信源發(fā)生
發(fā)表于：1/7/2011 12:00:00 AM
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基于VHDL+FPGA的自動(dòng)售貨機(jī)控制模塊的設(shè)計(jì)與實(shí)現(xiàn)
發(fā)表于：1/5/2011 12:00:00 AM
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SAW傳感器后端信號(hào)處理電路的設(shè)計(jì)
發(fā)表于：1/3/2011 12:00:00 AM
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基于FPGA和VHDL的USB2.0控制器設(shè)計(jì)
發(fā)表于：10/19/2010 10:04:40 PM
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基于FPGA的電子密碼鎖的研制
發(fā)表于：10/19/2010 3:39:43 PM
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基于VHDL 的矩陣鍵盤及顯示電路設(shè)計(jì)
發(fā)表于：10/9/2010 3:41:49 PM
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FPGA時(shí)序收斂
發(fā)表于：10/9/2010 8:56:17 AM
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基于VHDL的線性分組碼編譯碼器設(shè)計(jì)
發(fā)表于：9/26/2010 9:37:01 AM
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基于VHDL的可變速彩燈控制器的設(shè)計(jì)
發(fā)表于：9/26/2010 9:26:00 AM
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新型SDH系統(tǒng)設(shè)計(jì)及FPGA仿真
發(fā)表于：9/8/2010 3:47:40 PM
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基于CPLD的16位高精度數(shù)字電壓表設(shè)計(jì)
發(fā)表于：9/1/2010 9:30:44 AM
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基于FPGA的多按鍵狀態(tài)識(shí)別系統(tǒng)設(shè)計(jì)方案
發(fā)表于：8/25/2010 3:36:21 AM
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基于VHDL的交通燈控制器設(shè)計(jì)
發(fā)表于：6/30/2010 9:34:03 AM
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VHDL語言為核心的EDA技術(shù)在醫(yī)學(xué)中的應(yīng)用
發(fā)表于：6/10/2010 12:00:00 AM
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基于FPGA的μC/OS-II任務(wù)管理硬件設(shè)計(jì)
發(fā)表于：4/27/2010 12:00:00 AM
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VHDL設(shè)計(jì)中信號(hào)與變量的區(qū)別及賦予初始值的技巧
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基于CPLD／FPGA的VHDL語言電路優(yōu)化設(shè)計(jì)
發(fā)表于：3/22/2010 12:00:00 AM
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時(shí)統(tǒng)對時(shí)精度測量設(shè)備的設(shè)計(jì)與研究
發(fā)表于：2/24/2010 12:00:00 AM
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基于FPGA“乒乓球比賽游戲機(jī)”的設(shè)計(jì)
發(fā)表于：2/22/2010 12:00:00 AM
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基于Petri網(wǎng)的并行控制器的VHDL實(shí)現(xiàn)
發(fā)表于：2/8/2010 12:00:00 AM
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基于VHDL的PCI總線數(shù)據(jù)采集卡的研究
發(fā)表于：1/27/2010 12:00:00 AM
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基于FPGA的三線制同步串行通信控制器設(shè)計(jì)
發(fā)表于：12/17/2009 11:20:02 AM
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基于FPGA的線陣CCD驅(qū)動(dòng)時(shí)序發(fā)生器設(shè)計(jì)
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數(shù)字系統(tǒng)設(shè)計(jì)中VHDL語言設(shè)計(jì)問題探討
發(fā)表于：11/6/2009 4:00:25 PM
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基于FPGA的視頻監(jiān)測系統(tǒng)
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一種基于CPLD譯碼的DSP外部Flash燒寫方法
發(fā)表于：8/17/2009 2:39:56 PM
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Libero IDE v8.4環(huán)境下的FPGA數(shù)字系統(tǒng)設(shè)計(jì)
發(fā)表于：8/12/2009 2:55:47 PM
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嵌入式單總線控制器設(shè)計(jì)
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基于FPGA的高速A/D轉(zhuǎn)換控制器設(shè)計(jì)
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發(fā)表于：9/2/2008 4:00:00 PM
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