| Altera FPGA_CPLD設(shè)計(jì)基礎(chǔ)篇 | |
| 所屬分類：解決方案 | |
| 上傳者：scorpio | |
| 文檔大小：24559 K | |
| 標(biāo)簽： FPGA | |
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| 文檔介紹：本書涵蓋了所有Altera主流FPGA/CPLD硬件結(jié)構(gòu)與特點(diǎn)，詳盡地討論了Quartus II與第三方EDA工具的設(shè)計(jì)方法，系統(tǒng)闡述了Altera可編程邏輯設(shè)計(jì)優(yōu)化技術(shù)。 | |
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