| 一種低功耗Sigma-Delta調制器的設計 | |
| 所屬分類：參考設計 | |
| 上傳者：aet | |
| 文檔大小：1674 K | |
| 標簽： IC設計軟件 | |
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| 文檔介紹：采用改進的單環二階2 bit調制器架構和低功耗AB類放大器電路，實現了一種應用于無線收發機系統中的低功耗Sigma-Delta調制器。利用Matlab/Simulink進行了建模仿真，優化調制器系數，并采用TSMC 0.18 μm CMOS工藝進行了電路設計。電路仿真結果表明, 在采樣頻率為1.228 8 MHz、過采樣率為64時，調制器的信號噪聲諧波失真比達到77.0 dB，功耗為1.18 mW，具有低功耗特點。 | |
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