基于數(shù)字鎖相環(huán)的晶振頻率同步模塊設(shè)計(jì)
所屬分類：技術(shù)論文
上傳者：aet
文檔大小：464 K
標(biāo)簽： FPGA
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文檔介紹：為滿足現(xiàn)代通信技術(shù)、雷達(dá)技術(shù)、電子測(cè)量以及光電應(yīng)用領(lǐng)域?qū)Ω叻€(wěn)定度高準(zhǔn)確度時(shí)鐘的要求，設(shè)計(jì)了一種基于數(shù)字鎖相環(huán)的晶振同步系統(tǒng)。系統(tǒng)以基于FPGA數(shù)字延遲線的高分辨率鑒頻鑒相器以及在MicroBlaze核中實(shí)現(xiàn)的卡爾曼數(shù)字環(huán)路濾波器為核心，通過(guò)16 bit DAC微調(diào)本地晶振振蕩頻率，使其同步于GPS秒脈沖，從而獲得了高準(zhǔn)確度高、穩(wěn)定度的本地時(shí)鐘。
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