| 基于FPGA 的單精度浮點數(shù)乘法器設計 | |
| 所屬分類：解決方案 | |
| 上傳者：aet | |
| 文檔大小：245 K | |
| 標簽： FPGA | |
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| 文檔介紹：設計了一個基于FPGA的單精度浮點數(shù)乘法器.設計中采用改進的帶偏移量的冗余Booth3算法和跳躍式Wallace樹型結(jié)構(gòu),并提出對Wallace樹產(chǎn)生的2個偽和采用部分相加的方式,提高了乘法器的運算速度;加入對特殊值的處理模塊,完善了乘法器的功能.本設計在Altera DE2開發(fā)板上進行了驗證. | |
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