2020年3月31日，中國(guó)廣州-全球增長(zhǎng)最快的可編程邏輯公司-廣東高云半導(dǎo)體科技股份有限公司（以下簡(jiǎn)稱“高云半導(dǎo)體”）今日宣布，高云半導(dǎo)體自主研發(fā)的邏輯綜合工具Gowin Synthesis支持VHDL（Very-High-Speed Integrated Circuit Hardware Description Language）硬件描述語(yǔ)言流程綜合。

　　VHDL語(yǔ)言誕生于1982年，最初是由美國(guó)國(guó)防部開(kāi)發(fā)出來(lái)供美軍用來(lái)提高設(shè)計(jì)可靠性和縮減開(kāi)發(fā)周期的一種使用范圍較小的設(shè)計(jì)語(yǔ)言。1987年，VHDL被IEEE確認(rèn)為標(biāo)準(zhǔn)硬件描述語(yǔ)言。VHDL和Verilog是當(dāng)前電子系統(tǒng)硬件行為描述領(lǐng)域最主流的兩種語(yǔ)言。此前，Gowin Synthesis已支持Verilog/System Verilog語(yǔ)言的全流程編譯綜合。

　　“VHDL語(yǔ)言的支持進(jìn)一步完善了高云自主開(kāi)發(fā)的綜合工具對(duì)傳統(tǒng)RTL語(yǔ)言的編譯支持，也進(jìn)一步滿足了用戶在各類開(kāi)發(fā)需求下的不同語(yǔ)言編譯或混合編譯需求。”高云半導(dǎo)體軟件資深總監(jiān)劉建華博士表示，“高云自主研發(fā)的綜合工具自發(fā)布一年多以來(lái)，在編譯質(zhì)量和用戶體驗(yàn)上已經(jīng)受到了很多客戶的好評(píng)，也有很多用戶在自己的設(shè)計(jì)開(kāi)發(fā)過(guò)程中將Gowin Synthesis作為默認(rèn)首選的綜合工具，相信此次VHDL流程的支持，將為我們更多的用戶帶來(lái)更大的便利！”

　　VHDL編譯的支持，在完善Gowin Synthesis編譯流程的同時(shí)，也進(jìn)一步完善了高云FPGA開(kāi)發(fā)的整個(gè)工具鏈，高云將持續(xù)為用戶提供更加快速的器件支持、更優(yōu)質(zhì)的編譯結(jié)果和更好的用戶體驗(yàn)。云源設(shè)計(jì)軟件1.9.5版本將支持上述最新的邏輯綜合工具，同時(shí)延續(xù)Synplify Pro的支持。