基于FPGA的語音識別前端算法研究實現
所屬分類：技術論文
上傳者：aet
文檔大?。?span>299 K
標簽： FPGA
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文檔介紹：通過分布式語音識別DSR的研究,提出了基于FPGA平臺的前端處理系統結構。對其中兩個除法器分別采用了LUT查找表和常數除法器的結構。用VerilogHDL語言進行建模仿真,并與Matlab的建模結果進行了對比。結果表明,與之前的方法相比,系統能夠在較短的時鐘周期內計算出LPCC系數,節省了大量的運算時間和一定的面積。
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