基于FPGA的高性能離散小波變換設計
作者：王亞娟 曠捷 倪奎 王安文
摘要： 在數字信號處理領域，小波變換無論在理論研究還是工程應用方面都具有廣泛的價值，因此高性能離散小波變換的FPGA實現架構的研究就顯得尤為重要。本文針對db8 (Daubechies 8)小波設計了一個16階16位的正、反變換系統，用DE2開發板進行了系統驗證，在FPGA的邏輯單元資源消耗12%的情況下，正、反變換的最高時鐘頻率分別達到了217.72MHz、217.58MHz。對比同類文獻，本設計在最高處理速度方面具有明顯的優勢。在此基礎上，考慮到通用性的要求，本文還設計了一種小波種類可選、小波階數可調的通用小波變換FPGA架構，該通用小波正、反變換系統的最高時鐘頻率分別為114.10 MHz、152.09 MHz。此結構具有通用性強的特點，可高性能實現多種小波變換。設計采用DA(Distributed Arithmetic)算法和LUT(Look-Up Table)技術來實現小波變換中的濾波器，并使用流水線結構以及調用Altera 提供的IP核完成了設計的優化，用MATLAB驗證了設計的功能。
Abstract：
Key words :
摘 要：在數字信號處理領域，小波變換無論在理論研究還是工程應用方面都具有廣泛的價值，因此高性能離散小波變換的FPGA實現架構的研究就顯得尤為重要。本文針對db8 (Daubechies 8)小波設計了一個16階16位的正、反變換系統，用DE2開發板進行了系統驗證，在FPGA的邏輯單元資源消耗12%的情況下，正、反變換的最高時鐘頻率分別達到了217.72MHz、217.58MHz。對比同類文獻，本設計在最高處理速度方面具有明顯的優勢。在此基礎上，考慮到通用性的要求，本文還設計了一種小波種類可選、小波階數可調的通用小波變換FPGA架構，該通用小波正、反變換系統的最高時鐘頻率分別為114.10 MHz、152.09 MHz。此結構具有通用性強的特點，可高性能實現多種小波變換。設計采用DA(Distributed Arithmetic)算法和LUT(Look-Up Table)技術來實現小波變換中的濾波器，并使用流水線結構以及調用Altera 提供的IP核完成了設計的優化，用MATLAB驗證了設計的功能。
關鍵詞：DWT；IDWT；FPGA；Mallat算法；DA算法
此內容為AET網站原創，未經授權禁止轉載。