基于ATE的千級(jí)數(shù)量管腳FPGA多芯片同測(cè)技術(shù)
所屬分類(lèi)：技術(shù)論文
上傳者：wwei
文檔大小：3523 K
標(biāo)簽： 現(xiàn)場(chǎng)可編程門(mén)陣列 自動(dòng)化測(cè)試系統(tǒng) 多芯片同測(cè)
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文檔介紹：隨著超大規(guī)模FPGA芯片技術(shù)發(fā)展，芯片管腳數(shù)量提升到1 000以上，如何實(shí)現(xiàn)超大規(guī)模多引腳FPGA芯片高效測(cè)試成為ATE在線(xiàn)測(cè)試難點(diǎn)。針對(duì)一款千級(jí)數(shù)量管腳超大規(guī)模的FPGA芯片，基于FPGA的可編程特性，采用多芯片有效pin功能并行測(cè)試和單芯片全pin電性能參數(shù)測(cè)試相結(jié)合的方法進(jìn)行ATE測(cè)試，實(shí)現(xiàn)了千級(jí)數(shù)量管腳FPGA芯片的4芯片同測(cè)，測(cè)試效率提升3倍多。
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