使用 ISE 設(shè)計(jì)工具優(yōu)化FPGA 的功耗
通過功耗驅(qū)動(dòng)的新型后端流程可降低Virtex-4、Virtex-5 和Spartan-3 設(shè)計(jì)中的功耗
2008-07-25
作者：Subodh Gupta 博士，
??? 自從 Xilinx 推出 FPGA 二十多年來，研發(fā)工作大大提高了 FPGA 的速度和面積效率，縮小了 FPGA 與 ASIC 之間的差距，使 FPGA 成為實(shí)現(xiàn)數(shù)字電路" title="數(shù)字電路">數(shù)字電路的優(yōu)選平臺(tái)。今天，功耗日益成為 FPGA 供應(yīng)商及其客戶關(guān)注的問題。
??? 降低 FPGA 功耗是縮減封裝和散熱成本、提高器件可靠性以及打開移動(dòng)電子設(shè)備等新興市場(chǎng)之門的關(guān)鍵。Xilinx 在提供低功耗" title="低功耗">低功耗 FPGA 解決方案方面一馬當(dāng)先。本文說明如何應(yīng)用計(jì)算機(jī)輔助設(shè)計(jì)" title="計(jì)算機(jī)輔助設(shè)計(jì)">計(jì)算機(jī)輔助設(shè)計(jì) (CAD) 技術(shù)，如 Xilinx ISE 9.2i 軟件中采納的技術(shù)，來有效降低功耗" title="降低功耗">降低功耗。
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