| 盲信號處理中FastICA算法的IP核設(shè)計(jì) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：420 K | |
| 標(biāo)簽： 盲信號處理 DMA 乒乓RAM | |
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| 文檔介紹：針對盲信號處理中FastICA算法處理速度慢、性能差的問題，提出使用FPGA實(shí)現(xiàn)FastICA算法的方案，以提高FastICA算法的處理能力。設(shè)計(jì)了基于Avalon總線的FastICA IP核，嵌入到SoPC和ASIC設(shè)計(jì)中。仿真測試結(jié)果表明,FastICA IP核實(shí)現(xiàn)了盲信號分離，處理速度是PC的20倍，滿足了高速盲信號處理的需要。 | |
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