一種改進型surendra背景更新算法的FPGA實現
所屬分類：技術論文
上傳者：aet
文檔大小：329 K
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文檔介紹：針對現有的動態背景提取運動目標物體算法復雜且難以在硬件上實現的問題，研究了改進型surendra背景更新算法原理的特點，提出了改進型surendra背景更新算法的硬件結構，并對硬件結構進行綜合、仿真后，在FPGA芯片上實現。
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