| 基于高速嵌入式系統(tǒng)的信號(hào)完整性分析 | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：304 K | |
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| 文檔介紹：提高信號(hào)完整性、減小串?dāng)_和反射是高速電路系統(tǒng)設(shè)計(jì)能否成功的關(guān)鍵。本文基于以ARM1176JZF-S S3C6410為核處理器的嵌入式開發(fā)系統(tǒng)，對(duì)高速電路進(jìn)行了研究。通過信號(hào)完整性仿真分析，解決了DDR SDRAM差分時(shí)鐘信號(hào)的反射問題和視頻輸出信號(hào)的串?dāng)_問題。 | |
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