基于FPGA的同步數(shù)據(jù)采集處理系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
所屬分類：技術(shù)論文
上傳者：aet
文檔大?。?span>191 K
標(biāo)簽： FPGA
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文檔介紹：針對(duì)目前多通道數(shù)據(jù)采集系統(tǒng)的局限，以EP1K50系列的FPGA為核心控制模塊，AD7656為模數(shù)轉(zhuǎn)化芯片實(shí)現(xiàn)了精度為16位、最大采集速率為250kS/s的同步模擬信號(hào)采集系統(tǒng)，采用Flash存儲(chǔ)采集到的數(shù)據(jù)，且可以通過(guò)PC104總線將數(shù)據(jù)傳輸?shù)缴衔粰C(jī)。給出了系統(tǒng)的電路設(shè)計(jì)、關(guān)鍵模塊邏輯圖以及軟件流程圖。
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